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處理器體系結(jié)構(gòu)

• 雙核ARM Cortex-A9 MPCore處理器
• 最大頻率達(dá)800MHz
• 支持(AMP)對(duì)稱多處理（SMP）和非對(duì)稱多處理（AMP）
• 每個(gè)處理器內(nèi)核包括：
• 32 KB的L1指令高速緩存
• 32 KB的L1數(shù)據(jù)高速緩存
• NEONTM媒體處理引擎
• 單精度和雙精度浮點(diǎn)單元
• 存儲(chǔ)器管理單元(MMU)
• 專用間隔定時(shí)器
• 專用看門(mén)狗定時(shí)器
• 512 KB的共享2級(jí)（L2）高速緩存
• 用于緩存一致性的SCU
• 加速器一致性端口（ACP）
• 全局定時(shí)器
• 普通中斷控制器
• CoreSight?指令跟蹤

存儲(chǔ)器接口支持

• 多端口SDRAM控制器子系統(tǒng)
• DDR2和DDR3
• LPDDR1和LPDDR2
• 錯(cuò)誤校正代碼（ECC）
• 閃存控制器
• 帶直接存儲(chǔ)器訪問(wèn)（DMA）
  和可選ECC的NAND
• 四串行外圍接口(SPI)（NOR）
• 安全數(shù)字（SD）/安全數(shù)字I/O
  (SDIO)/帶DMA的多媒體卡（MMC）

接口外設(shè)

• 兩個(gè)帶有DMA的10/100/1000Mbps以太網(wǎng)介質(zhì)訪問(wèn)控制器（EMAC）
• 兩個(gè)支持DMA的USB 2.0 On-The-Go (USB OTG) 控制器
• 四個(gè)I2C控制器
• 兩個(gè)控制器局域網(wǎng)（CAN）、兩個(gè)主SPI、兩個(gè)從SPI、UART
• 達(dá)71個(gè)一般用I/O（GPIO）
  和14個(gè)僅輸入引腳

調(diào)試

• IEEE標(biāo)準(zhǔn)1149.1-2001（JTAG）
• CPU調(diào)試訪問(wèn)端口（DAP）
• 通過(guò)高級(jí)高性能總線訪問(wèn)端口（AHB-AP）引導(dǎo)存儲(chǔ)器調(diào)試
• 支持DMA的嵌入式跟蹤路由器（ETR）
• 處理器跟蹤
• 系統(tǒng)總線跟蹤
• 操作系統(tǒng)（OS）跟蹤
• 片上跟蹤存儲(chǔ)

硬核處理器系統(tǒng)

系統(tǒng)外設(shè)

• 四個(gè)一般用定時(shí)器
• 兩個(gè)看門(mén)狗定時(shí)器
• 8通道DMA控制器
• 用于FPGA配置的FPGA管理器
• 時(shí)鐘和復(fù)位管理器

片上存儲(chǔ)器

• 64KB片上RAM
• 64KB片上引導(dǎo)ROM

HPS/FPGA接口

• HPS-to-FPGA橋
• 處理器和DMA訪問(wèn)FPGA外設(shè)
• 可配置32位、64位或128位高級(jí)微控制器總線體系結(jié)構(gòu)（AMBA?）高級(jí)可擴(kuò)展接口（AXI?）
• FPGA至HPS橋接
• FPGA主機(jī)可訪問(wèn)處理器子系統(tǒng)外設(shè)
• 可配置32位、64位或128位AMBA AXI接口
• 通過(guò)ACP一致性訪問(wèn)處理器緩存
• FPGA至HPS SDRAM控制器子系統(tǒng)接口
• FPGA訪問(wèn)DRAM的共享存儲(chǔ)器
• 多達(dá)6個(gè)主機(jī)，4x64位讀和4x64位寫(xiě)數(shù)據(jù)
• 其他
• FPGA至HPS中斷
• DMA握手接口（可讓FPGA外設(shè)向系統(tǒng)DMA控制器進(jìn)行模塊級(jí)傳輸）
• More than 100Gbps HPS-to-FPGA and FPGA-to-HPS bandwidth